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Raw Blame History

VirtualFPGA

介绍

用SDL开发的虚拟FPGA，配合Verilator使用

软件架构

软件架构说明

安装教程

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使用说明

使用Verilator

使用Veriloator，把Verilog转换成C++。 Virtual FPGA需要使用Verilator生成的一些接口。

编写两个辅助函数

接下来，你需要编写两个辅助函数update_input()和update_output()。当你在虚拟FPGA上改变输入（比如拨动一个开关）的时候，虚拟FPGA会自动调用update_input()，让你编写的模块能够收到这个改变。模块得到新的输出之后，虚拟FPGA会调用update_output()，把模块的输出同步到GUI上。

体验虚拟FPGA

要改变某个按键或开关的状态，可以使用键盘快捷键，将来也可以点击鼠标。

参与贡献

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新建 Pull Request

特技

可以用include/configs.h选择贴图，让自己的虚拟FPGA开发板更有特色，贴图放在pic目录下；

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